在DC的约束中,这个两个图非常重要且实用。
第一个图是时序约束方法,分为以下三种:
- 设置输入延迟 set_input_delay
- 设置输出延迟 set_output_delay
- 设置时钟周期 creat_clock
第二个图为环境约束方法,分为以下四种:
- 设置输入驱动单元 set_driving_cell
- 设置输出负载单元 set_load
- 设置工作环境 set_operating_conditions
- 设置连线负载 set_wire_load_model