FPGA的LVDS电平以及LVDS25电平能在HR Bank上使用吗？

在FPGA的HR BANK上供电3.3V，先就其差分端口而言，LVDS电平以及LVDS25电平能否约束到这个BANK上呢？

解决这个问题前，先了解下

1、什么是HR Bank以及HP bank：

Xilinx的7系列FPGA有两种IO Bank：HP（High Performace）和HR（High Range）。HP（high-performance）I/O banks的设计目的是为了获取更高的Memory及chip-to-chip间的传输速率；而HR（high-range）I/O banks的设计目的是为了更宽的I/O电平标准。两种BANK的IO口电压不同,其中HR I/O Banks的VCCO电压最大为3.3V,HP I/O banks的VCCO电压最大为1.8V。特别是初次使用7系列时，在硬件设计中特别要注意它们I/O口的最大工作电压，一不注意就会把电压搞错，导致FPGA不能正常工作。

2、HR和HP banks的LVDS电平

当两个banks的I/O口作为LVDS电平时，HR banks的I/O电压VCCO只能为2.5V，HP banks的I/O口电压为1.8V。两个banks支持LVDS的标准不同，HR I/O banks的I/O只能分配LVDS_25标准，HP分配为LVDS标准。

LVDS_25的直流特性如下表所示。

LVDS的直流特性如下表所示。