数字后端三千问——No.4

这是一篇整理自群内讨论的数字后端设计问题解答集,涵盖了reg放置、transition与动态功耗关系、DC关注点、icc优化、lib pin类型等10个热点问题。解答者们分享了他们的经验和建议,旨在帮助设计师解决问题并提升技能。
摘要由CSDN通过智能技术生成

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最近把我们三个群里各位学友们的提问解答整理了一下,这是一份宝贵的知识库,应当整理成文档。由于编辑码字很慢,暂时每次整理十个问题,全部发完以后会按照功能分类编辑做成合集。这些问题都是大家平时做设计时遇到的难点,很有价值。希望大家多多提问讨论,继续活跃群气氛,一起努力进步~~

看看这期你的问题有没有上榜~~

31)来自一群活跃群友“♪───O”0?wx_fmt=png的提问

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各位大牛:由于SI端的hold比较多,而且很严重,直接用PT修了一把。发现是由于reg place的太近了,导致buffer插的太远。有什么方法可以让reg摆的远一点呢?

给所有reg加上cell pad或者inst pad就行,然后setPlaceMode -honorInstPad true来控制reg之间的间距

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感谢“马道长”0?wx_fmt=png的回答

32)来自一群活跃网友“LoongJiang”0?wx_fmt=png的提问

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问一下transition和动态功耗的关系?

我觉得transition大小和dynamic功耗很难判断关系,因为每个cell的toggle rate都不一样。假如一些logic是非常low freq的,那尽量用小cell,transition大一点也无所谓。只要meet timing就行,如果high freq的logic,那就不得不做小一些transition,还是得看你是侧重dynamic power小呢,还是leakage power小,有时候两个不能兼得的

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