DSP28335 中断机制、寄存器赋值及GPIO各寄存器

最新推荐文章于 2023-10-19 10:15:32 发布
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分类专栏： 笔记随笔 文章标签： DSP28335 中断机制 GPIO
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本文链接：https://blog.csdn.net/a346544987/article/details/94997325
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本文详细介绍了DSP28335的中断机制，包括CPU级、PIE级和外设级中断，并阐述了中断管理的相关寄存器。同时，讲解了GPIO的寄存器操作，如功能选择、方向选择、数据寄存器等，以及如何进行整体赋值和位赋值。
摘要由CSDN通过智能技术生成

中断机制

28335中断分3个层级：CPU级——PIE级——外设级

CPU级

包括

NMI（不可屏蔽中断）

16个可屏蔽中断：INT1–INT14;DLOGINT;RTOSINT（常用INT1–INT12，这12个接外设中断拓展模块）

CPU级中断管理

IFR (中断标志，表示该通道出现了中断，置1)

IER （中断使能，置1了才去处理该通道中的中断）

INTM （中断总阀，置1开启才会处理各个通道的中断，否则不会处理任何中断）

PIE级

承包了CPU级INT1–INT12这12个通道，每个通道在此又分为8个外部中断源（8个岔路）

PIE级中断管理

PIEIFRx.y （中断标志，类比CPUIFR）

PIEIERx.y （中断使能，类比CPUIER）

PIEACKx （PIE级总使能标志，PIE 级进入CPU 级的门禁）
置1，将PIEACK[0]位清0，从而打开后续INT1 的PIE 级到CPU 级的中断，否则会出现该组某一中断一直出现的情况，这样就会导致CPU无法处理同组的其它外设申请的中断。

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