Quartus实现D触发器及时序仿真

最新推荐文章于 2024-05-03 21:45:57 发布
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Quartus实现D触发器及时序仿真

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一.Quartus输入原理图及时序仿真

（一）创建工程

File->New Project…
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填写相关内容
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选择芯片
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（二）创建方框文件

File->New,选择Block Diagram/Schematic File
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选择nand2，两个输入的非与门，依次添加四个nand2和一个非门not
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连线
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（三）编译原理图文件

启动分析与综合
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硬件电路图
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（四）创建vwm格式波形文件

选择vwm
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选择Edit->Insert->Insert Node or Bus
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添加Node or Bus
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效果
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编辑输入Clk，产生时钟信号
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选择D进行编辑
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进行仿真，结果如下
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Turing_kun
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Quartus 2 RS、D、JK、T、触发器实验报告 D触发器构成二分频、四分频电路
05-26
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dong11123的博客
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/dwave 是文件名** module dwave(d,clk,q);input clk;**output q;选择 Edit->Insert->Insert Node or Bus。使用 rtl viewer 查看硬件电路图\硬件电路图。返回 vwm 文件中，点击时序仿真，仿真结果如下。点击 File->New，选中 Verilog。依次添加四个 and2 和一个非门 not。鼠标选择 D，Q 信号 Q_n,，进行编辑。编辑输入 Clk，产生时钟信号。添加 Node or Bus。
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11-29 6850
基本要求有两个稳定的状态(0、1)，以表示存储内容能够接收、保存和输出信号。现态和次态现态: On触发器接收输入信号之前的状态次态: O(n+1)触发器接收输入信号之后的状态分类按电路结构和工作特点: 基本、同步、边沿按逻辑功能分:RS、JK、D和T(T')其他: TTL和 CMOS，分立和集成下面我会一一详细讲解，并且通过Quartus II作出电路图进行仿真测试。
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m0_51592017的博客
11-10 6229
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