PLL环路分析

PLL环路分析前有以下几个概念：
1.锁相环（Phase Lock Loop）是phase domain。
2.相位与频率和时间的关系： θ=ωt+φ=2πft+φ ，当时间t看作常量时，相位也可以做AC分析。
3.环路分析是在系统稳定的情况下，进行小信号分析。

锁相环系统由于其PFD和CP的开关采样特性，整个系统实际上是一个离散系统。使用离散的z域模型分析更适合。当环路带宽小于参考频率的十分之一时，可以使用连续的s域模型来近似（环路滤波器将CP输出的离散信号滤波了）。下图就是锁相环相位的线性s域模型。

接下来推导各个模块表达式。当环路是稳定时，理想状态下θin=θfb。假设输入多了一个Δφ的微弱相位增量。看这个微弱相位增量在环路中引起的变化。
PFD和CP是把相位差转换为电流，则在一个参考输入周期T内由Δφ带来充电或放电时间为：

电荷泵电流源提供的电流为ICP，在一个周期内的平均充电电流为：

由上式可以看出ICP/2π即是PFD和CP级联的相位差到输出电流的传输函数。

Vcontrl/Icp就是环路滤波器的传输函数Zlf(s)。

VCO则被模拟成一个积分器。压控振荡器的传输特性为：

Δω(t)=KVCOΔVcntrl(t)

其中ΔVcntrl是控制VCO的电压，KVCO是VCO的增益，表示控制电压与频率增量的关系，可以通过仿真获取。角频率对时间积分就是相位，对两边积分有：

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上式在s域中的表示方式为：

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可见KVCO/s就是VCO的传输函数。分频器的传输函数就是分频比分之一。综述所述，可以得到锁相环的开环传递函数，开环位置是在分频器的输出处：

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在实际电路中也可以建立模型，进行stb仿真。

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