#VERDI# 关于UVM Debug Mode UG 学习（一 环境准备）

最新推荐文章于 2024-04-17 16:34:42 发布
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分类专栏： # VCS__verdi 文章标签： VCS
原文链接：https://blog.csdn.net/Holden_Liu/article/details/106909625
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基本介绍

Verdi UVM Debug Tool : 是针对UVM 平台的debug工具，可以像打开RTL一样，层次化显示testbench，便于阅读。同时针对UVM特有的Resource,Factory,Phase,Sequence,Register,TLM connection等，可以显示仿真的详细内容，便于调试。

环境准备

环境变量: $VERDI_HOME, $LD_LIBRARY_PATH 等

TB: 包含reg_model，及本学习model 的目录层次结构如下：

 Makefile 

和正常的编译运行一样，只需在run time阶段，加上 “-gui=verdi" 即可。

参考文档

User Guide: UVMDebugUserGuide.pdf in $VERDI_HOME/doc

Verdi online doc: Verdi Ooline Doc //need log in SolvNet before

testbench使用的是《UVM实战》的7.4.3章节源码：

那么菜
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专栏目录
UVMDebugUserGuide_uvmdebuguserguide_UVM_
10-01
uvm debug userguide. uvm debug userguide
uvm+vcs+verdi基本平台搭建
11-09
uvm+vcs+verdi基本平台搭建,也许平台不是很难，但是网上没有 UVM 在 VCS 中的详细教程，但是对于初学者就是一道屏障，我探索了几天，下文将一步一步的举例子说明 UVM+VCS+Verdi 的 liunx 平台搭建过程
Verdi Protocol Analyzer Debug 简单使用
Holden_Liu的博客
06-24 4992
文档与源码： User Guide: UVMDebugUserGuide.pdf VCApps_Protocol_Analyzer.pdf in $VERDI_HOME/doc testbench: 使用SNPS VIP的examples 介绍： Verdi UVM Debug tool: 针对UVM 平台的debug工具，可以像打开RTL一样，层次化显示testbench，便于阅读。同时针对UVM特有的Resource,Factory,Phase,Sequence,Register,T...
verdi 单步调试
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weixin_49256707的博客
04-17 445
4. 比如我设置断点是2110000ps位置，按快捷键F10 或者simulation->run/continue 跑到断点位置。对get_actual变量，右键，Add to Watches->Add to Watch 1。在交互式窗口输入next，或者快捷键F10，或者菜单栏 Simulation->Step/Next->Next。此时，包就不是null，而是有值了，可以查看包中各个变量的值。因为，此时这个变量，还没有获取到值，因此值为null。此时，波形也会显示到当前仿真时刻，各个信号的波形。
verdi uvm debug
qq_40268651的博客
03-19 1331
本篇文章总结了一些verdi UVM Debug的仿真选项，内容和图片来自于verdi 2020版的官方UVM Debug User Guide文档。文档中部分内容与实际使用时不符，可能与verdi版本有关。
用Verdi 查看UVM环境中的变量等信息
分享记录一下工作中遇到的相关知识
07-04 1675
看register model里面的值也是类似的做法，找到 register view，然后找到 register model 添加 register 到 waveform里面。答案是有的，下面让我们看看是怎么做到的。下面我们看下 uvm component里面的信息，通过指定一个 component 然后右击 add to waveform 就可以看 component的信息。跑完仿真之后，我们点击Verdi 里面 UVM这个地方，会出现UVM的环境。跑仿真的时候会跳出下面verdi的界面。
Verdi UVM Debug Mode 简单使用
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待续
(AHB VIP为例)Verdi UVM/interactive debug mode简单使用
geter_CS的博客
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AHB VIP为例，Verdi UVM/interactive debug mode简单使用
linux VCS+verdi实现UVM实战第二章例子
12-23
适合初学者
Verdi-debug workshop dramatically enhance your debugging efficiency.pdf
08-05
Verdi的高级教程
verdi 功能学习 资料
12-15
Verdi 是一种功能强大且功能学习资料，旨在帮助用户更好地理解复杂设计，快速追溯 bug 的根源，并在友好的一体化环境中进行调试和验证。本文档将对 Verdi 的功能和使用方法进行详细介绍。 一、技术背景 Verdi 基于...
uvm user guide
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uvm user guide: uvm入门手册，新手必备
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vcs+verdi+uvm单步调试及查看所有phase的运行状态
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12-17 1517
vcs+verdi联合仿真中的单步调试
verdi显示OVM/UVM Hierarchy View
qq_36683398的博客
10-09 1069
使用vcs+verdi+UVM进行UVM debug的时候，verdi加载的时候看不到UVM树形结构图。verdi显示OVM/UVM Hierarchy View。需要先仿真一定时间（自己定），然后就可以常看树形结构了。打开界面后，并不会直接显示树形层级。
UVM学习之路（2）— 使用VCS+Verdi进行仿真调试
qq_38113006的博客
10-23 1万+
UVM学习之路（2）— 使用VCS+Verdi进行仿真调试 一、前言 Verdi最初是由Novas Softwave公司设计的，后属于了SpringSoft公司，最终SpringSoft被Synopsys公司收购，Verdi正式属于Synopsys。 Verdi可以调用第三方工具进行编译仿真产生波形文件并可以查看、可查看源代码对应的电路图，最强大之处在于可以在源代码、原理图、波形图和状态图之间进行即时跟踪，协助工程师debug。原文 参考文章 ：Linux下VCS与Verdi联合仿真简易教程及例子示范
UVM环境debug的正确开启方式
W1Z1Q的专栏
07-01 2084
本文主要讲述了UVM提供了哪些调试代码的内置方法，可以让用户事半功倍，提升效率。
verdi debug c++
07-16
### 回答1： "Verdi Debug C"是一种用于调试C语言程序的工具。Verdi是一个集成的调试环境，它提供了各种功能来帮助开发人员分析和修复C语言程序中的错误。 Verdi Debug C具有以下特点和功能： 1.源代码级调试：Verdi Debug C允许开发人员逐行调试C语言程序，以便更好地理解程序的执行流程和变量的值。它可以在源代码级别下暂停程序执行，以便开发人员检查变量的值、条件语句的结果和函数调用的顺序。 2.变量观察：Verdi Debug C提供了一个变量窗口，可以实时监视程序中所有变量的值。这使得开发人员可以在调试过程中检查变量的状态，并识别问题所在。 3.条件断点：Verdi Debug C允许开发人员设置条件断点，即只在满足特定条件时才暂停程序的执行。这对于定位特定问题或在特定情况下调试程序非常有用。 4.数据可视化：Verdi Debug C提供了数据可视化工具，帮助开发人员以图形方式呈现数组、结构体和其他复杂数据结构的值。这大大简化了复杂数据结构的调试过程。 5.回溯：当程序中发生错误或异常时，Verdi Debug C可以提供完整的回溯信息，包括函数调用序列和各个函数的参数和变量值。这可以帮助开发人员追踪问题发生的位置和原因。 总的来说，Verdi Debug C是一个强大的调试工具，它提供了多种功能来帮助开发人员识别和解决C语言程序中的错误。它可以加快调试过程，提高开发效率，并最终改善程序的质量和性能。 ### 回答2： verdi debug c 是一种在C语言中进行调试的工具。VERDI是一个完全集成的调试和验证环境，适用于硬件描述语言和软件开发。它提供了强大的功能，可以帮助程序员快速定位和修复代码中的错误。 使用verdi debug c，你可以在调试过程中观察变量的值，查看函数的输入和输出参数，以及跟踪程序的执行流程。它还提供了一些高级功能，比如断点和条件断点，可以方便地暂停程序的执行，以便检查程序的状态。 在进行c语言调试时，verdi debug c还可以配合一些其他工具一起使用，比如gcc编译器和gdb调试器。通过这些工具的协作，可以更有效地进行调试，提高程序的质量和稳定性。 总之，verdi debug c是一个强大而实用的调试工具，它可以帮助程序员在C语言开发中更快地定位和修复错误，提高代码的质量和可靠性。

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