FPGA图像处理的仿真测试激励该如何写？

已于 2023-10-01 15:21:19 修改
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文章标签： fpga开发 图像处理
于 2022-06-25 15:04:34 首次发布
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本文介绍如何编写FPGA图像处理模块的仿真测试激励，包括读取位图文件生成仿真输入波形和将仿真结果存入输出位图。讲解了如何处理24位和32位位图文件，以及如何利用Verilog测试激励代码处理图像数据，并通过仿真观察输出结果。同时，讨论了文件头的读取、图像尺寸获取、像素数据的读取和输出数据的采样保存等问题。
摘要由CSDN通过智能技术生成

https://github.com/becomequantum/ 代码在这

FPGA图像处理的仿真测试激励该如何写？_哔哩哔哩_bilibili直接读位图文件生成仿真输入波形，再把仿真结果存入输出位图中。icon-default.png?t=N7T8https://www.bilibili.com/video/BV1ZS4y1H7oQ之前的这些视频讲了一些基本的FPGA图像处理Verilog代码该怎么写。但我想大家都知道，你只写了Verilog模块代码还是不够的，它不像软件编程代码那样写了就能运行看到结果。Verilog模块代码你想看到输出结果还得编写测试激励给这个模块提供数据输入信号，然后用仿真器跑仿真才能看到模块的输出波形。对于FPGA图像处理模块来说，写测试激励还会遇到两个问题：一是图像输入数据是比较多的，一般都存在bmp位图文件里，我们不可能把这些数据手写到测试激励代码里。这就涉及到该如何把位图文件里的图像数据读到测试激励里，然后形成仿真输入波形。第二

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qq_32010099
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但是被测试模块输入端对应的变量应该声明为 reg 型，如 clk，rstn 等，输出端对应的变量应该声明为 wire 型，如 dout，dout_en。因为 $fread 只能读取 2 进制文件，所以输入文件的第一行对应的 ASCII 码应该是 330a，所以我们想要得到文件里的数据 3，应该取变量 read_temp 的第 9 到第 8bit 位的数据。信号 data_in_temp 是对输入数据信号的一个紧随的整合，后面校验模块会以此为参考，来判断仿真是否正常，模块设计是否正确。
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