FPGA基础–基于Vivado的眼图测试(二)

四、生成.mcs文件
1.在“TCl Cons…”选项框中输入如下内容:
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红色文字部分是第三步中生成的.bit文件的地址及文件名,蓝色部分是即将生成的.mcs文件的地址及文件名;
2.输入完成后,单击回车,文件开始编译,出现如下提示则编译完成:
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蓝色文字部分为创建新项目时自定义的项目文件夹目录,红色文字部分是生成的.bit文件及.mcs文件后自动生成的文件夹地址;
.mcs文件于测试准备阶段烧写入待测试板卡中;.bit文件于测试过程中提供在线调试使用。
五、测试准备
1.将待测试的输入输出板卡烧写.mcs文件;
2.待测试输出板插入FPGA烧写器,与PC连接;
3.测试PC与待测试PC处于同一网段;
4.测试PC安装Vivado及SecureCRT Portable测试工具。
六、连接设备
1.待测设备开机;打开SecureCRT Portable测试工具;
2.输入主机名(即IP地址),用户名:root;点击“连接”;
3.显示如下界面即登录成功:
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七、读取眼图
1.打开Vivado,点击Open hardware manager:
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2.点击Open target,在下拉菜单选择Auto connect;
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3.出现下图则连接成功:
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出现下图所示,则连接失败:
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需要在线烧写.bit文件;
4.连接成功后,点击Create links:
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5.在弹出窗口中多次点击加号,将所有通道添加到下方,点击OK;
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6.在成功连接的通道处右键,选择Create Scan:
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7.弹出的窗口中,点击OK,等待眼图生成。
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FPGA是一种可编程逻辑设备,可以被重新编程以实现不同的电路功能。Vivado是一款由Xilinx开发FPGA开发环境软件。眼图测试是一种用来评估数字信号的正确性和稳定性的方法。 要进行FPGA基于Vivado眼图测试,首先需要有一个FPGA开发板和Vivado软件的安装包。安装好Vivado软件后,打开Vivado环境。然后,创建一个新的项目,选择适合你的FPGA开发板的芯片型号,并建立一个新的FPGA设计。 接下来,你需要编写一个设计代码,用于产生一个含有扰动的信号。你可以使用Verilog或VHDL语言来编写代码。确保你的设计代码中包括了适当的时钟周期和数据产生逻辑。 编写完设计代码后,你可以开始进行综合、实现和生成比特流文件的过程。通过综合,将设计代码转换为逻辑网表表示。然后,通过实现将逻辑网表映射到设备的资源上,并生成一个比特流文件,用于将设计加载到FPGA开发板中。 加载比特流文件到FPGA开发板后,连接适当的探针和示波器来监测FPGA的输出信号。在Vivado中,可以使用逻辑分析仪工具来创建眼图测试,并生成眼图结果。首先,设置适当的触发条件和采样速率。然后,开始采集数据并创建眼图眼图显示了信号的波形,可以评估信号的稳定性和正确性。通过观察眼图的打开度、噪声和抖动等指标,可以判断信号是否满足设计要求。如果眼图较小或存在噪声和抖动,则可能需要优化设计或更改电路参数。 在完成眼图测试后,可以综合分析眼图结果,并在需要的情况下对设计进行优化。通过迭代这个过程,可以逐步改善信号质量,确保FPGA设计的正确性和稳定性。 以上简要介绍了FPGA基于Vivado眼图测试教程。希望对您有所帮助。如需更详细的操作步骤,请参考相关的Vivado用户手册或教程。

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