PT静态时序分析 实践课

最新推荐文章于 2024-06-23 07:56:05 发布
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本文是一篇关于使用PT_shell进行静态时序分析（STA）的实践课程。内容包括如何载入先前的STA文件，设置PT环境，加载并更新布局文件，以及如何使用各种命令进行时序检查、历史记录查看和获取命令帮助。
摘要由CSDN通过智能技术生成

实践课

用pt_shell打开软件

pt_shell
做STA之前

1.已经有做过STA的文件时

用restore_session可以载入以前的文件：

restore_session share/

在这里插入图片描述
载入文件后检查时序：

report_timing

在这里插入图片描述
2.对post-layout做STA时：

首先设置PT的环境：

source /eda/synopsys/pt/2012.12/admin/setup/.synopsys_pt.setup

在这里插入图片描述
在这里插入图片描述
加载相应的文件：

set link_path "*  /home/...
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qq_38453556
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专栏目录
PT静态时序分析 第一课 第二课
qq_38453556的博客
11-20 5783
绪论 目录： 第一到第四课比较重要 第一课
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程序员野蛮成长
11-12 6346
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PT即Prime Time，一个STA静态时序分析的工具。它提取整个电路的所有时序路径，通过计算信号沿在路径上的延迟找出违背时序约束的错误，主要是检查建立时间和保持时间是否满足要求，而它们又分别通过对最大路径延迟和最小路径延迟的分析得到。STA中的“静态”是指整个电路的分析是静态进行的，不依赖于输入端口的激励，无需仿真向量，所以仿真会非常快。
静态时序分析（理论及Prime Time使用）——学习笔记
Anton_wzd的博客
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学习静态时序分析时记录的一些笔记，其中包含了对《Static Timing Analysis for Nanomter Designs》的一些翻译，以及在网络收集到的一些注意事项等。理解不是很全面，会在不断学习中继续完善的。欢迎交流，一起加油！！！冲冲冲！！！
芯片后端之 PT 《工具使用教程》
最新发布
那么菜的博客
06-23 708
PT即Prime Time，一个STA静态时序分析的工具。它提取整个电路的所有时序路径，通过计算信号沿在路径上的延迟找出违背时序约束的错误，主要是检查建立时间和保持时间是否满足要求，而它们又分别通过对最大路径延迟和最小路径延迟的分析得到。STA中的“静态”是指整个电路的分析是静态进行的，不依赖于输入端口的激励，无需仿真向量，所以仿真会非常快。1、PT配库文件PR后的布局布线网表（版图网表）、时序约束文件sdc、PR后的spef2、PT过程文件。
pt修时序实战经验
godping的博客
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pt、手动修时序相关经验
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09-09 1万+
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笨蛋大乌龟的博客
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