FIFO最小深度计算

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分类专栏： FPGA/IC秋招笔试/面试 FPGA/IC秋招经典100题 FPGA/IC秋招笔试面试题（续） 文章标签： FIFO fpga开发
于 2021-07-23 17:01:46 首次发布
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本文详细探讨了FIFO最小深度的计算方法，通过举例说明在不同读写速率下如何确定FIFO的最小深度，以确保数据传输时不丢失。在写入速率大于读取速率的情况下，FIFO深度需要能容纳未被读走的数据；当读取速率等于写入速率时，FIFO主要起时钟域转换作用，最小深度为1。文中还给出了多个具体计算示例，帮助理解FIFO深度计算的实践应用。
摘要由CSDN通过智能技术生成

FIFO最小深度计算

文章目录

1、FIFO最小深度

  在数据的传输中当读速率慢于写速率时，FIFO便可被用作系统中的缓冲元件或队列，类似于水流经过一个缓冲区，上游水流速度快，下游水流速度慢，部分水就可以被缓存在中间的缓冲区，但是上游与下游的水速差距过大，就会导致流入中间缓存区的水超出了缓存区承受能力导致水的溢出，不能顺利到达下游。在上游水流速度最大，下游水流速度最小的情况下，中间缓冲区不能溢出的大小就是我们关系的问题。
在这里插入图片描述
  同理，读写速率差距过大，FIFO深度太小，就会导致一段时间内向FIFO灌输的数据超出了FIFO的承受能力，就会导致数据的丢失，该容量取决于读写数据的速率。所以在写速率最大，读速率最小时，这时正好不导致数据溢出的FIFO的深度就是我们要计算的FIFO最小深度。

FIFO写入速率快，读出速度慢模型：

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