锁相环技术原理及FPGA实现(第三章3.2)

本文详细介绍了锁相环的工作原理,对比了锁相环与基本负反馈电路的区别,强调了环路在负反馈条件下的相位跟踪功能。通过分析一阶锁相环的SystemView模型,探讨了VCO输出的同相支路,并讨论了锁相环的基本性能参数,包括捕获及跟踪过程。内容涉及环路稳定、相位差和频率跟踪等方面,展示了通过仿真验证一阶锁相环的工作状态和捕获带宽,揭示了理论分析与实际工程设计的差异。
摘要由CSDN通过智能技术生成

3.2.3 锁相环与基本负反馈电路的区别

        锁相环是一个相位负反馈电路。也只有当锁相环构成了一个相位负反馈电路后,环路才具有相位跟踪功能。
        图 3-1 与图 3-7 如何对应起来呢? PLL 中输入信号的相位1( ) t 能够对应反馈电路中的Xi 吗? PLL 中的基本放大电路和反馈网络分别是哪一部分电路呢?这些都是我们必须要理清的问题。
        问题 3-3:锁相环中的各组成部件与典型反馈电路中的部件是如何对应的?
        我们先讨论一下开环状态。根据前面讨论的反馈电路结构,环路开环时,由反馈网络输出的信号反馈到输入端,相当于反馈网络处于断开状态。锁相环也是一个反馈电路,开环状态时,是否 VCO 的输出信号也需要完全断开?如果断开的话,则鉴相器会输出什么样的信号呢?将鉴相器类比于基本放大电路,放大增益如何计算呢?
        问题似乎越来越多。我们现在来分析一下。首先假设锁相环在开环状态下, VCO 输出也是断开的,根据图 3-5 的正弦鉴相器模型,此时鉴相器的输出信号相当于直接对输入信号u t i ( ) 进行低通滤波后的信号。

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