Modelsim Error(vsim-3033)：Instantiation of ‘fifo_generator_v13_2_3‘ failed. The design unit was not

于 2024-05-23 19:17:32 发布
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分类专栏： FPGA MODELSIM 文章标签： fpga
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vivado与modelsim联合仿真时无法顺利完成，出现报错 Error(vsim-3033)：…/bd/system/ip/system_fifo_generator_0_0/sim/system_fifo_generator_0_0.v(291): Instantiation of ‘fifo_generator_v13_2_3’ failed.The design unit was not found.

解决方案

重新编译仿真库，具体步骤如下
1.在vivado首页，Tools–>Compile Simulation Libraries…，按下图操作后，点击Compile，等待大概半小时左右
image.png
2.编译完成后，在Tcl 控制台这里会输出一个报告
image.png
我这里输出结果有一个报错，这时就需要翻一下看看哪里出现了Error，最后发现ldcp_v2_0_2出现了error，不过我查一下，这个不影响，因为一般不会用到，具体这篇文章 有说。
image.png
image.png
3.打开设置，选择“Simulation” 选项卡
image.png
4.切换到"3rd Party Simulators"选项卡，如下设置，点击OK
image.png
5.运行仿真，接下就会弹出MODELSIM，选择需要仿真的信号，点击Run即可
image.png

提示

我之前试过直接换一个之前编译好的库，结果不行，现在找到原因 了。因为里面的modelsim.ini 文件使用的是绝对路径，如果要正常运行需要修改modelsim.ini 文件。
image.png

参考资料

Vivado与ModelSim的联合仿真_vivado选择modelsim10.6c-CSDN博客
modelsimSE-64 10.6安装及与vivado联合教程_modelsim10.6d安装教程-CSDN博客
Vivado与modelsim仿真卡在Executing analysis and compilation step界面的问题_executing elaborate step-CSDN博客

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Modulesim Error: (vsim-3033) The design unit was not found的解决办法
hayiji的专栏
03-01 8338
找不到模块，有可能是你的模块名称写错了；模块语法有错误，没有编译成功；还有可能是库文件你没有包含进去。 下面讲讲加载库文件的方法。在我的上一篇文章中，已经给出了找到库中特定模块的方法。按照这个方法找到模块后，记住库的名称。 点击菜单Simulation->StartSimulation。在弹出的对话框中，选择Libraries标签页，点击Add...,在弹出的对话框中点击向下的箭头。 选中库就能加载这个库了。然后再进入Design标签页中，选择待仿真的模块，按下底部的OK即可进行仿真了。 .
# ** Error: (vsim-3033) F:/QuartusProject/ceshi/simulation/modelsim/key_led_vlg_tst.v(17): Instantia
最新发布
FY11111111的博客
04-02 328
1、在工程完整的情况下（在这里我拿“按键控制led”这个小设计为例进行说明，这个设计包括key_filter和led_ctrl两个小模块），也就说我把key_filter(按键消抖)和led_ctrl(led控制)的代码都实现以后，分别生成他们的原理图（这个操作步骤我在这里不再赘述），然后新建一个原理图文件，在这个原理图文件里将这两个模块用信号线连接（包括输入输出以及模块之间的信号流动）。那我前边也说过，由于modelsim无法识别原理图，所以我们解决这个问题的关键就是将这个原理图转换成.v文件就可以了。
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ModelSim报错:Instantiation of ‘***‘ failed. The design unit was not found.
qq_59529218的博客
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FPGA学习：MODESIM与FPGA原理图联合仿真错误（VSIM 3033)
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在QUARTUS中编译能够成功，Modelsim仿真时出现如下错误 ：“erro: Instantiation of '***' failed. The design unit was not found"。原因：在Modelsim中只能新建HDL类的文件，而不能采用原理图输入的方式，即Modelsim不能识别”原理图输入“方式。 解决方法：首先，将原理图文件怎么变成HDL文件，FILE-&gt...
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09-19
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09-19
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09-23
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vivado与modelsim联合仿真
mkelehk的专栏
11-12 4643
1，创建modelsim工程，除了将自己的代码拷贝到工程里面外，还需要将vivado生成的fifo ip下用于仿真的源文件：sim/xxx.v（此处为fifo_dl.v）拷贝进modelsim工程里： 编译通过后，选中“Simulate->Start simulation...”添加预先编译好的vivado库fifo_generator_v13_2_1路径： 最后，开始仿真： ...
【奔跑的FPGA】part two ip核仿真遇到的问题以及解决办法
u011153192的博客
07-18 5407
一般来说，用modelsim进行仿真分为两种。 第一种直接用modelsim建立工程，加入.v文件，编写测试文件.vt，手动添加需要的库文件，比较麻烦； 第二种借助第三方软件调用modelsim进行仿真，如用quartus ii调用。这种方法会导致在仿真的时候出现很多奇葩的问题，主要就是缺少库文件造成的。 例如： # ** Error: (vsim-3033) C:/altera/test
fifo_generator核
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fifo_generator核是一种IP核，可以用于创建FIFO（First In, First Out）缓冲区。它被设计成只与自由运行的写和读时钟一起工作，并且可以通过写使能信号(wr_en)和读取使能信号(rd_en)来控制FIFO的操作。该核具有多个端口，包括时钟信号(clk)、复位信号(rst)、数据输入端口(din)、写使能信号(wr_en)、读取使能信号(rd_en)、数据输出端口(dout)、FIFO满状态信号(full)、FIFO空状态信号(empty)等。在使用fifo_generator核时，可以通过配置IP核的参数和端口来满足具体的需求。如果需要了解更多关于FIFO Generator核的信息，可以访问Xilinx的官方网站进行下载相应的说明文档。<span class="em">1</span><span class="em">2</span><span class="em">3</span> #### 引用[.reference_title] - *1* *3* [Xilinx_FIFO_IP核的使用](https://blog.csdn.net/qq_40147893/article/details/107727448)[target="_blank" data-report-click={"spm":"1018.2226.3001.9630","extra":{"utm_source":"vip_chatgpt_common_search_pc_result","utm_medium":"distribute.pc_search_result.none-task-cask-2~all~insert_cask~default-1-null.142^v93^chatsearchT3_2"}}] [.reference_item style="max-width: 50%"] - *2* [【PG057】FIFO Generator IP核学习](https://blog.csdn.net/lum250/article/details/120641213)[target="_blank" data-report-click={"spm":"1018.2226.3001.9630","extra":{"utm_source":"vip_chatgpt_common_search_pc_result","utm_medium":"distribute.pc_search_result.none-task-cask-2~all~insert_cask~default-1-null.142^v93^chatsearchT3_2"}}] [.reference_item style="max-width: 50%"] [ .reference_list ]

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