Xilinx FPGA 未使用pin 状态约束

最新推荐文章于 2024-02-11 01:35:53 发布
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该博客主要介绍了如何在FPGA设计中通过设置BITSTREAM.CONFIG.UNUSEDPIN属性，将未使用的引脚配置为默认拉低、拉高或悬浮状态，以确保电路的稳定性和可靠性。

默认拉低：set_property BITSTREAM.CONFIG.UNUSEDPIN Pulldown [current_design]
默认拉高：set_property BITSTREAM.CONFIG.UNUSEDPIN Pullup [current_design]
悬空： set_property BITSTREAM.CONFIG.UNUSEDPIN Pullnone [current_design]
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