【嘉立创EDA】原理图显示/隐藏引脚标识

本文介绍了如何在嘉立创EDA专业版V2.1.17中操作显示或隐藏器件引脚标识。通过两种方法,包括直接修改选中引脚属性和在库中修改默认设置,帮助用户更方便地核对封装脚位。

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文章解决问题

1️⃣
嘉立创EDA专业版,操作版本是V2.1.17客户端半离线版本。

本文基于嘉立创EDA专业版讲述如何将原理图中已建立的器件的引脚标识进行显示或隐藏。本文将此过程记录,以供有需要的读者参考。

主题内容

2️⃣
对目标器件,直接拉出后,有显示引脚的需求
在这里插入图片描述
来辅助核对具体封装中的脚位:
在这里插入图片描述
分割线–分割线–分割线–分割线–分割线–分割线–分割线–分割线–分割线–分割线–分割线–
方法1:
直接选中某个要显示的引脚,而不是整个器件!!!修改属性
在这里插入图片描述

### 关于嘉立创PCB设计中接地引脚直接铺铜的做法与建议 在进行PCB设计时,对于接地引脚的处理至关重要。为了确保良好的电气性能和信号完整性,在嘉立创平台上的PCB设计过程中对接地引脚采用直接铺铜是一种常见做法。 #### 铺铜的目的 铺铜的主要目的是提供低阻抗路径给电流返回电源负极或地平面,从而减少噪声干扰并提高系统的稳定性[^1]。 #### 实施方法 当完成元件放置之后进入布线阶段前可以考虑如下操作: - **建多边形填充区** 使用软件中的工具来定义一个多边形区域作为地平面上的一部分,并指定其网络名称为GND(即地)。这一步骤可以通过菜单栏选择相应的命令实现。 ```python # 建一个多边形对象用于表示地平面 polygon = Polygon() polygon.setNetName('GND') ``` - **关联到特定焊盘/过孔** 将上述建的地平面连接至实际物理位置上的每一个需要接地的地方——比如IC芯片底部大面积暴露出来的金属部分或是其他任何带有专门标注为“GND”的引脚处。这种连接通常会自动由EDA工具建起来,但有时也需要手动调整以确保最佳效果。 - **设置优先级参数** 对于某些特殊需求的应用场合下可能还需要进一步配置一些属性选项,像最小宽度、间距以及热敏系数等数,以便更好地控制最终生成的结果质量。 #### 注意事项 在整个过程中有几个要点需要注意: - 确认所有应该连通的位置都已经正确无误地加入了进来; - 如果存在多个独运作却都要求良好接地特性的模块,则最好各自单独设不同的地层面再经由单一点位汇合在一起形成统一的整体结构; - 完成后务必执行DRC检测功能排查潜在错误,保证整个项目文件没有任何违反规则的情况发生[^3]。
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