【Verilog】10.7-10.8 其他论题——层次路径名、共享任务和函数

已于 2023-08-29 19:14:39 修改
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分类专栏： Verilog 文章标签： arm开发 fpga开发 硬件工程 前端 linux
于 2023-08-29 19:13:44 首次发布
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10.7-10.8 其他论题——层次路径名、共享任务和函数

10.7 层次路径名

Verilog HDl中的标识符具有一个唯一的层次路径名。层次路径名通过由句点（.）隔开的
名字组成。新层次由以下定义：
1) 模块实例化
2) 任务定义
3) 函数定义
4) 命名程序块
任何标识符的全称路径名由顶层模块（不被任何其它模块实例化的模块）开始。这一路
径名可在描述的任何层次使用。实例如下。图 1 0 - 1显示了层次。

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10.8 共享任务和函数

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