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Verilog
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【Verilog】11 验证——编写测试验证程序(test bench)、波形产生、从文本文件中读取向量、向文本文件中写入向量
【代码】【Verilog】11 验证——编写测试验证程序(test bench)、波形产生、从文本文件中读取向量、向文本文件中写入向量。原创 2023-08-30 17:01:50 · 1323 阅读 · 0 评论 -
【Verilog】10.9-10.8 其他论题——值变转储文件(VCD)、指定程序块(specify)、强度、竞争状态
【代码】【Verilog】10.9-10.8 其他论题——值变转储文件(VCD)、指定程序块(specify)、强度、竞争状态。原创 2023-08-30 10:43:06 · 272 阅读 · 0 评论 -
【Verilog】10.7-10.8 其他论题——层次路径名、共享任务和函数
【代码】【Verilog】10.7-10.8 其他论题——层次路径名、共享任务和函数。原创 2023-08-29 19:13:44 · 220 阅读 · 0 评论 -
【Verilog】10.4-10.6 其他论题——禁止语句、命名事件、结构描述方式和行为描述方式的混合使用
禁止语句是过程性语句(因此它只能出现在 a l w a y s或i n i t i a l语句块内)。禁止语句能够在任务或程序块没有执行完它的所有语句前终止其执行。它能够用于对硬件中断和全局复位的建模。原创 2023-08-29 18:42:33 · 96 阅读 · 0 评论 -
【Verilog】10.3 其他论题——系统任务和系统函数
Verilog HDL提供了内置的系统任务和系统函数,即在语言中预定义的任务和函数。它们分为以下几类原创 2023-08-29 17:35:45 · 44 阅读 · 0 评论 -
【Verilog】10.1~10.2 其他论题——系统任务和系统函数
函数,如同任务一样,也可以在模块不同位置执行共同代码。函数与任务的不同之处是函数只能返回一个值,它不能包含任何时延或时序控制(必须立即执行),并且它不能调用其它的任务。此外,函数必须带有至少一个输入,在函数中允许没有输出或输入输出说明。函数可以调用其它的函数。原创 2023-08-29 16:06:04 · 41 阅读 · 0 评论 -
【Verilog】9 结构建模
【Verilog】9 结构建模原创 2023-08-29 14:15:28 · 29 阅读 · 0 评论 -
【Verilog】8 行为建模
verilog 第8章 行为建模原创 2023-08-29 11:23:06 · 59 阅读 · 0 评论 -
【Verilog】7 数据流模型化
verilog 7 数据流模型化原创 2023-08-28 19:10:07 · 46 阅读 · 0 评论 -
【Verilog】6 用户定义的原语(UDP)
verilog 用户定义的原语 UDP原创 2023-08-28 15:03:45 · 52 阅读 · 0 评论 -
【Verilog】5 门电平模型化——可使用的内置基本门
【代码】【Verilog】5 门电平模型化——可使用的内置基本门。原创 2023-08-28 10:32:37 · 187 阅读 · 0 评论 -
【Verilog】3 语言要素——数据类型
【代码】【Verilog】语言要素——数据类型。原创 2023-08-26 18:34:20 · 67 阅读 · 0 评论 -
【Verilog】3 语言要素——编译指令
【代码】【Verilog】语言要素——编译指令。原创 2023-08-26 17:11:34 · 469 阅读 · 0 评论