ila触发不到波形

已于 2024-09-28 09:43:30 修改
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于 2024-09-27 10:22:40 首次发布
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目前的解决方法是修改JTAG时钟频率，屡试不爽。

1. open new target

2.直接next，将jtag时钟改为5M

3.直到finish，即可触发。

ILA避坑

1、ILA的采样时钟太低会受JTAG频率钳制，太高会受时序资源钳制
2、ILA不能探测自己的工作时钟，因为上升沿采样时永远对应自己的高电平，可以用PLL给ILA提供一个更高的工作频率
3、ILA可以用来代替逻辑分析仪，把探针绑IO口上就行，注意信号的电平和频率。另外高频信号的杜邦线离远一点，有可能串扰

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整个在线调试工具ILA Croe的使用基本就讲完了，如果需要了解更多有关ILA 的使用， 可以进行更多的尝试和查看 IP 手册。 本章以计数器为例学习了简单的时序逻辑设计，并学习了在线调试工具 ILA 的用法。
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vivado中ila无法换成模拟信号
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在Vivado中，ILA是用于调试FPGA设计时的工具，可以用于捕获和显示FPGA内部信号的状态。如果您想捕获模拟信号而不是FPGA内部信号，则需要使用Vivado Logic Analyzer。 要使用Vivado Logic Analyzer，您需要执行以下步骤： 1. 在Vivado中打开Design Sources窗口，然后单击Add Sources按钮。 2. 选择Add or create simulation sources选项，然后单击Next。 3. 在Add or create simulation sources窗口中，选择Create File选项，然后单击Next。 4. 在Create Simulation Source窗口中，选择VHDL或Verilog语言，然后输入文件名，例如testbench。 5. 单击Finish，然后在Design Sources窗口中双击新创建的testbench文件。 6. 在编辑器中添加所需的模拟信号。 7. 在Vivado中打开Simulation窗口，然后单击Run Simulation。 8. 在Simulation窗口中，选择Waves窗口，然后单击Add Wave按钮。 9. 在Add Wave窗口中，选择VCD/FSDB File选项，然后单击Next。 10. 在VCD/FSDB File窗口中，选择testbench文件，然后单击Next。 11. 在VCD/FSDB File窗口中，选择所需的模拟信号，并将其添加到波形窗口中。 12. 在Vivado中打开Hardware Manager窗口，然后单击Open Target按钮。 13. 在Hardware Manager窗口中，选择Open New Target选项，然后选择FPGA设备。 14. 配置FPGA设备，然后单击Program按钮。 15. 在Hardware Manager窗口中，单击Open Debug按钮。 16. 在Debug窗口中，选择Logic Analyzer选项，然后单击Add Trigger按钮。 17. 在Add Trigger窗口中，选择触发条件，例如当模拟信号达到特定值时触发。 18. 单击OK，然后单击Start按钮。 19. 在波形窗口中，观察模拟信号的状态并进行调试。 注意：使用Vivado Logic Analyzer需要在设计中添加适当的模拟信号，并在仿真中捕获这些信号。如果您没有添加适当的模拟信号，则无法使用Vivado Logic Analyzer进行调试。
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