HDL Edgedetect 和Edgedetect2

1原题复现

在这里插入图片描述

2.代码
第一种方法:

在这里插入图片描述
上述代码在ISE仿真软件中生成的RTL Schematic为:
在这里插入图片描述

第二种方法

在这里插入图片描述生成的RTL Schematic 图:
在这里插入图片描述
总结:可见不同的代码,将会生成不同的RTL原理图

Edgedetect2 原题复现

在这里插入图片描述

代码

在这里插入图片描述

总结:Edgedetect和Edgedetect2 的不同之处在于:
Edgedetect 这道题只有在in的七位比特里面任一比特从0变为1的时候,才会是的输出上相应的比特位也变为1,也就是只有in只有在比特位处于上升沿的时候,out中相应的位才会在下一个时钟沿到来时候输出1。因此不能使用异或,只能通过判断 前一次的in和后一次的in比较,是否有零变为1的比特位,来实现输出的比特位是否应该为高电平。即~in_pre&in_current
Edgedetect2 而这道题,是in的七位比特里面任一比特变化,不管从0变为1还是从1变为0,输出上相应的比特位都会输出为1,因此使用异或逻辑是可以实现的。

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