Verdi_如何dump信号的驱动强度

本文介绍了在Verilog环境下使用VCS仿真时如何通过`fsdb`选项和环境变量来记录信号的驱动强度,以便于检测和调试驱动强度相关的仿真错误。默认情况下,VCS不显示这些信息,启用后可观察到详细波形。
摘要由CSDN通过智能技术生成

Verdi_如何dump信号的驱动强度

需求背景

Verilog语法标准中,01各自被分成了8个强度等级;

Strength NameStrength NameStrength Level
supply 0supply 17
strong 0strong 16
pull 0pull 15
large 0large 14
weak 0weak 13
medium 0medium 12
small 0small 11
highz 0highz 10

VCS仿真默认只记录逻辑0和逻辑1,不记录强度;

许多协议中,信号的驱动强度是有规定的;

如果仿真错误是由于驱动强度引起的,单纯从默认的波形中难以发现;

使能方法

方法一

simv仿真选项中加入+fsdb+strength=on,单次生效;

on,使能;off,关闭;

simv <other options> +fsdb+strength=on

方法二

定义环境变量NOVAS_FSDB_STRENGTH,全局生效;

1,使能;0,关闭;

setnv NOVAS_FSDB_STRENGTH 1

效果示例

默认波形(无strength):

默认波形

使能后波形(有strength):

使能后波形

参考:

【新思验证小课堂】【Verdi】如何dump信号的驱动强度:https://www.bilibili.com/video/BV1ds4y1y7aV/?spm_id_from=333.999.0.0&vd_source=1f0262949a2c3f16eba5397faec73908

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