数字后端面试问答No.19-21(每日三问)

数字后端面试问答No.19-21(每日三问)

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前阵子由于小编忙着编写基于 28nm 工艺 ARM Cortex-A53 CPU 的数字后端实现教程，所以在数字后端面试问答这块并没有更新多少。就在昨天小编知识星球上的会员发来一条消息，希望多发点数字后端笔试面试题目（因为马上就要开始新一年的校园招聘了）。为了满足这部分粉丝的要求，后续会继续分享数字后端面试问题。

1.What are isolation cells and why they are needed?

• Isolation cells are used in gated power domains

• Isolation cells are used to avoid transferring the un-known state from power gating domain to always on domain

• Isolation cell will be kept until shutdown domain is powered on

• Isolation cell are placed in AON domain

• Isolation cell are added in DC or ICC by Function ECO

这些低功耗设计实现经验，你真的懂了吗？

2.Please explain clock pulse absorption phenomena

当 clock tree 上的 buffer 或者 inverter 的 rising time 和 falling time 不 balance 的时候，有可能出现 clock min pulse width 问题，严重情况下可能会丢失某个 clock 脉冲。

如果 PLL 出来的时钟路径上用了不 balanced 的 clock buffer 或者 data buffer，极端情况下可能会导致某个时段 clock 丢失的情况，从而导致系统功能性的错误。

为什么时钟树上要用 clock inverter(min pulse width check)

3.How to add LOCKUP LATCH by function ECO in ICC or PT when you find big hold violation in SI pin of DFF?

这个问题在实际项目中特别常见，属于家常便饭类型的。主要原因有以下几点：

• Function clock 和 scan clock 结构不合理，比如结构上太早分叉，导致 common path 特别短，引起较大的 hold violation

• 将两个异步 clock domain 中的 DFF 串在一条 scan chain 上。

解法方法：

• 硬着头皮插 hold buffer。这种方法可能需要在某个 SI pin 上连续插上百个 buffer，想想就觉得风险大，也挺恐怖的。

• 通过 ECO 方式（断线连线），在这两个寄存器之间 create 一个 LOCKUP LATCH 来解决特别大的 hold violation。这种方法效果特别明显。

Lockup latch 的用法，看这个就够了！

听说 Latch 可以高效修 hold 违例（Timing borrowing 及其应用）

断线连线的方式，通过 disconnect_net 和 connect_pin 来实现。这里需要指出的是，做完这个 ECO 后务必比下 Formal。

如果你对这种方法仍然不懂，就来小编的星球吧，手把手教你。

小编知识星球简介：

在这里，目前已经规划并正着手做的事情：

• ICC/ICC2 lab 的编写

• 基于 ARM CPU 的后端实现流程（已经发布）

• 利用 ICC 中 CCD（Concurrent Clock Data）实现高性能模块的设计实现（已经发布）

• 其他内容待定（一定会有更多的实践教程）

在这里，各位可以就公众号推文的内容或者实际项目中遇到的难题提问，小编会在 24 小时内给予解答（也可以发表你对数字后端设计实现中某个知识点的看法，项目中遇到的难点，困惑或者职业发展规划等）。

反正它是一个缩减版的论坛，增强了大家的互动性。更为重要的是，微信有知识星球的小程序入口。星球二维码如下，可以扫描或者长按识别二维码进入。目前已经有二十九星球成员，感谢这二十九位童鞋的支持！欢迎各位铁杆粉丝加入！终极目标是打造实现本知识星球全员年薪百万的宏伟目标。 （星球的门槛将会越来越高，有需求的朋友趁早上车）****

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