VivadoAndTcl: generate_target

最新推荐文章于 2024-08-13 16:12:00 发布
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分类专栏： # VivadoAndTcl 文章标签： fpga fpga开发 硬件工程
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本文链接：https://blog.csdn.net/bzh19940620/article/details/134568285
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这个命令可以对指定的IP对象（get_ips）或者IP核源文件（.xci和.xco）或者dsp模块（.slx和.mdl）或者块设计（.bd）生成目标数据，目标数据包括支撑IP核和块设计进行FPGA设计流程的所有必须数据。用法非常简单，举例如下：

generate_target changelog [get_ips] -force
generate_target all [get_ips]

Unknown_Fighter
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