Xilinx 7系列逻辑资源总结

最新推荐文章于 2024-05-08 17:35:05 发布
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一. CLB构成

LUT可以被配置为一个6-input LUT和两个5-input LUT，一个5-inpu LUT可以存在于FF中
4个6-input LUT、8个FF，乘法器、移位寄存器等资源共同组成一个Slice。8个FF中，有4个可以配置成锁存器latch，但是这样的话，Slice中剩余的4个FF则不可以再使用。
2个Slice构成一个CLB.

二. Slice分类

Slice可以分为Slice-L和Slice-M，Slice-L是Logic Slice，Slice-M用处比较多，其中的LUT可以用来构成分布式64-bit RAM (Distributed RAM)和32-bit移位寄存器（SRL32）或两个SRL16。
数量上，大约有2/3的Slice是Slice-L，余下为Slice-M

greenapl1985
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