封装参数可配置的IP核

最新推荐文章于 2024-05-14 08:44:55 发布

keilzc

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原文链接：https://blog.csdn.net/fpgadesigner/article/details/75309278

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本文采用的设计是一个简单的位宽可设置的加法器。

首先建立一个工程用于设计IP核，这个工程最好放在Vivado目录下或不会被删除的地方。添加一个源文件，输入一个简单的组合逻辑加法器的代码：

在这里插入代码片
 `timescale 1ns / 1ps

module Add_USR_IP #(parameter WIDTH = 1)(
    input [WIDTH:0] a,
    input [WIDTH:0] b,
    output cout,
    output [WIDTH:0] c
    );

    assign {cout, c} = a + b;

endmodule

点击左边“Flow Navigator”中的“Settings”，打开“IP”下的“Packager”。设置自己的IP核的库名和目录。
点击上方菜单栏中的“Tools”下的“Create and Package New IP”，跟着流程一直走最后Finish即可，将在工作区弹出如下界面，包含了IP核的一些信息，名称为“Add_USR_IP_v1_0”。
在“compatibility”界面给出了这个IP可以支持的FPGA系列，默认是支持全部系列。“File Groups”中可以看到这个IP包含的文件，可以为这个IP添加一个仿真文件来验证其功能。

5. 为了实现加法位宽可调整，源程序中使用了parameter参数。打开上述界面中的“Customization Parameters”标签，将看到这个参数WIDTH：
在这里插入图片描述
双击WIDTH，将弹出一个参数设置框。里面可以指定这个参数在配置IP核是的格式以及是否可以被用户编辑。我们在这里将“Specify Range”勾选中，将Type更改为“Range of integers”，表示此参数可以选择的范围。将Minimum设置为0，Maximum设置为31，表示该IP核最高可设置为32位的加法器。最后再将“Default Value”指定为7，表示默认为8位加法器。在这里插入图片描述
6. 第3步骤的“Ports and Interfaces”中将看到IP核的管脚信息，“Customization GUI”中将看到IP核的原理图图形。没有问题后切换到“Review and Package”标签，点击“Package IP”会提示成功生成IP核。