FPGA编译综合出现 Warning (10230): Verilog HDL assignment warning at key_led.v(17): truncated value w

最新推荐文章于 2024-09-10 08:04:30 发布
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文章标签： fpga开发
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问题、

FPGA使用verilog HDL 语言编写按键指示灯时，编译出现 Warning (10230): Verilog HDL assignment warning at key_led.v(17): truncated value w  

原因：cnt<=cnt+1中的1没有指定位宽，系统默认32位，浪费资源

解决方法：指导位宽cnt<=cnt+1‘b1

lxfwn
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