FPGA跨时钟域学习笔记

最新推荐文章于 2024-07-20 15:32:35 发布
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文章标签： fpga开发 学习 笔记
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建立时间：tsu 保持时间：thd
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跨时钟域问题，高速ADC传入低速UART，在时钟上升沿到来之前数据应该tsu时间前来才能成功赋值，并且在保持时间thd之后才能撤销。否则出现问题xxxxx亚稳态。
解决办法：跨时钟处理
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1。异步赋值，同步释放
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2.慢时钟域到快时钟域（单bit）
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3快时钟域到慢时钟域（单bit）
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宋SCP
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