数字后端 - STA

本文介绍了数字后端中如何修复setup time violation,包括添加buffer/inverter、Resize、Move、Pin Swap、Restruct、Layer Assignment、Clone/Declone和Split/Merge等方法。详细讨论了时序弧、non-unate clock的概念,以及它们在时序路径和报告中的影响。通过对电路结构的优化,可以有效提高时序性能。
摘要由CSDN通过智能技术生成

Timing arc,中文名时序弧。这是timing计算最基本的组成元素,如果两个pin之间在timing上存在因果关系,我们就把这种时序关系称为Timing arc,主要分为定义时序延迟,和定义时序检查两种。为啥叫它时序弧?因为时序图中经常用一条弧形线段来表示它。如下图所示:cell的timing arc定义在lib中,
在这里插入图片描述
non-unate clock 意思是输出与输入无函数关系,即不相关的
non-unate path的意思就是单个输入固定时,输出也是不确定的,没有确定的函数关系,即不相关路径

根据synopsys的解释,理论上来说,时钟电路只能经过寄存器时钟端、buffer(正相关)、inverter(负相关),clock 经过or ,xor等除了与门和非门外的其他逻辑,就会被叫做non_unate

non-unate path会影响report_timing的结果吗?
DC\PT能够对付gated clock,但是不能对付non_unate gated clock.因为这样会产生不可预计的clock,所以对时钟的处理最好只用与门和非门逻辑。

如何修复set

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