电路中setup time和hold time怎么理解？

最新推荐文章于 2022-11-30 17:49:41 发布
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分类专栏： ASIC芯片设计流程 文章标签： 触发器
小 白 蒋
本文链接：https://blog.csdn.net/weixin_37413070/article/details/107386034
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作者：小白蒋，刚开始学习验证知识，有错误的地方欢迎留言交流。

建立时间：

是指在触发器的时钟信号采样边沿到来之前，数据保持稳定不变的时间；

保持时间：

是指触发器的时钟信号采样边沿到来之后，数据保持稳定不变的时间；

怎么理解这个setup time呢？

在这里插入图片描述
Tcq：触发器的时钟端C到时钟端Q的延迟，是器件属性，固定不变的；
Tcomb：是两个触发器之间组合电路的延时；

数据路径时间 = Tcq + Tcomb
在这里插入图片描述

Tskew : 相邻两个触发器之间的时钟偏移；
Tclk：时钟周期；
时钟路径时间 = Tclk + Tskew

setup time需要满足的条件：

时钟路径时间 - 数据路径时间 > setup time

得到：

Tsetup < Tclk + Tskew - (Tcomb + Tcq)

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