Vivado的SIMULATION的Scope和source的层级怎么看

已于 2024-03-26 10:31:02 修改
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分类专栏： FPGA 文章标签： FPGA
于 2024-03-25 13:34:47 首次发布
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 一、查看source

source的层级可以很容易看出来，上面是tb文件的名称，下面的

axi_full_wrapper : axi_full_wrapper (axi full wrapper.v) (1)中，右边的那个axi_full_wrapper是模块名称，也是源文件名称（因为module之后接的模块名，和.v文件一般是同名的），左边axi_full_wrapper是tb文件实例化之后的名称，因为我之前习惯实例化同名的实例。

下面的TOP_U0 :TOP (TOP.V) (2) 也是一样，TOP是.v文件也就是模块名称，TOP_U0是实例化的模块名称。

至于（1）（2）应该指的是第1，第二个实例。

然后对照着看tb的代码也能清楚地看出来。

二、查看scope

scope有很多作用，例如往仿真图像里面添加需要的信号波形,具体参考：AXI4的网格设计Block Design，添加信号，裁剪打包IP核-CSDN博客

起床学FPGA
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