verilog学习记录(10)——二线制IIC一

目录

一、二线制IIC CMOS串行EEPROM

二、IIC总线特征

三、读写操作


一、二线制IIC CMOS串行EEPROM

串行EEPROM硬件上有两根信号线,一根数据线SDA和一根时钟线SCL。

EEPROM数据的写入写出方式分两种:1.字节写入,顾名思义按字节进行数据写入。2.页写入,允许在一个写周期内同时对一个字节到一页的若干字节进行编程写入。页的大小由芯片内寄存器的大小决定。

二、IIC总线特征

总线协议定义:只有总线状态为“非忙”,数据可进行传输。

传输方式:SCL为高电平,SDA发生翻转,数据传输开启或停止;SCL为高电平,SDA保持稳定状态,SDA传输数据。

将IIC数据传输分为A,B,C,D四个工作状态。

1、总线非忙状态(A段):该段内数据线(SDA)与时钟线(SCL)均保持高电平。

2、启动数据传输(B段):当SCL为高,SDA由高转低,该下降沿为启动信号,启动信号出现后,其他信号有效。

3、停止数据传输(C段):当SCL为高,SDA由低转高,该上升沿为停止信号,停止信号出现后,所有外部操作结束。

4、数据有效(D段):出现启动信号后,在SCL为高时,数据线稳定,按位传输数据,每个时钟周期传输一位。

5、应答信号:接收数据的E2,每接收一个数据,发出一个ack应答信号;写入数据的E2,每写入一个数据,接收一个ack信号。

三、读写操作

3.1 读操作

写入帧:启动信号+1010(I2C总线器件特征编码)+3位芯片地址/页地址+写状态位(后续进行一字节数据写操作)+ack位+E2存储单元地址+ack位+写入数据+ack位+停止信号

读出数据帧:启动信号+1010(I2C总线器件特征编码)+3位芯片地址/页地址+写状态位(后续进行一字节数据写操作)+ack位+E2存储单元地址+ack位+启动信号+1010(I2C总线器件特征编码)+3位芯片地址/页地址+读状态位(后续进行一位数据读操作)+ack位+读出数据+非ack+停止信号

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FPGA(Field-Programmable Gate Array)是一种可编程逻辑器件,它能够在电路中实现各种数字逻辑功能。Verilog语言则是一种硬件描述语言,用于描述数字系统的行为和结构。本文将通过基于Altera EP4CE10(一款FPGA芯片)进行的FPGA Verilog开发实战指南,向读者介绍如何使用Verilog语言开发FPGA应用。 首先,选择合适的开发工具,例如Altera Quartus Prime软件。在Quartus中,创建一个新的工程,并添加Verilog源文件,用于编写FPGA应用的逻辑代码。在编写代码时,需要了解基本的Verilog语法和模块化设计的原则。 接下来,将FPGA芯片选项设置为Altera EP4CE10,并进行引脚分配。引脚分配是将逻辑信号与FPGA芯片引脚相连接的过程。确保正确地将输入和输出信号与特定引脚相连接,以实现所需的功能。 然后,进行逻辑编译和映射。逻辑编译将Verilog代码转换为低级逻辑网表,并进行逻辑优化。映射阶段将逻辑网表映射到FPGA芯片中的逻辑单元和开关资源。 在映射之后,进行时序分析和布线。时序分析用于验证设计在时序要求下的正确性,以确保信号传输的稳定性和准确性。布线是将逻辑资源与FPGA芯片中的物理资源相互连接的过程。 最后,进行编程和调试。将生成的比特流文件下载到FPGA芯片中,并进行信号调试和性能优化。通过使用逻辑分析仪等工具,可以检查信号的波形和逻辑的正确性,并根据需要进行调整和改进。 在进行FPGA Verilog开发实战时,需要具备较好的数字电路基础和Verilog语言掌握程度。通过实践和经验积累,不断提升对FPGA开发的理解和技能,才能开发出高效和可靠的FPGA应用。

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