【SystemVerilog基础】function/task 使用说明

已于 2023-05-07 23:35:43 修改
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分类专栏： # SystemVerilog基础 文章标签： UVM SystemVerilog iff
于 2022-03-03 13:26:01 首次发布
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本文详细介绍了SystemVerilog中function与task的区别，包括两者在调用、返回值、时序控制语句等方面的不同。重点讲解了function可以在线程中调用任务的特殊情况，以及如何处理函数的返回值，特别是void类型的函数。还提供了相关真题解析，帮助理解概念。
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文章目录

一、function与task的区别

函数function 任务task
执行与消耗 不消耗仿真时间 消耗仿真时间
仿真控制语句 函数中不能含有控制仿真时间的语句
如时间延迟#100，阻塞语句@（posedge clk）等		 任务中可以包含仿真时间控制语句
如延迟#100，时钟周期@（），wait（）以及事件event等语句
返回形式 函数的返回可以通过调用return语句实现，当不需要返回值时，可以将函数定义为void类型 任务没有返回值。一般通过output信号直接输出，也不需要关键字void【如果在task中使用return，会直接退出task】
形参变量 函数中至少包含1个输入变量进行传参（实践操作得：sv中function可以没有形参），输入、输出端口声明不能包含inout类型 任务中可以没有或者由多个输入、输出，且端口声明可以为inout类型
相互调用 函数中只能调用函数，不能调用任务 任务中可以调用任务，也可以调用函数
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