【AMD Xilinx】Avnet高性价比MPSoC评估板-ZUBoard(1):基本资料和开发流程

一、概述

1. 基本介绍

ZUBoard 1CG是Avnet(安富利)开发的一款基于Zynq UltraScale+ ZU1CG双核Cortex-A53 MPSoC、具有81K FPGA系统逻辑单元、配备了1GB LPDDR4 RAM、SYZYGY连接器,以及用于Click板的mikroBus扩展接口。

目前售价159美元,适用于评估人工智能、机器学习、嵌入式视觉、嵌入式处理和机器人等应用。

以前用Zynq系列比如7020、7010开发的项目,如果需要进一步提升性能,首选是升级到基于A53的MPSoC系列,比A9的性能大幅提升。而ZU1又是MPSoC系列中最具性价比的型号之一。

官网链接
https://www.avnet.com/wps/portal/us/products/avnet-boards/avnet-board-families/zuboard-1cg/

开发资料
https://www.hackster.io/avnet/products/zuboard-1cg

https://github.com/Avnet/freertos-oob/tree/main/ZUBoard-1CG

https://github.com/Avnet/hdl/

2. PCB外设示意图

在这里插入图片描述

3. 硬件框图

在这里插入图片描述
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IO管脚分配以及更多硬件信息请查看官网的 ZUBoard 1CG Hardware User Giude。

在这里插入图片描述

二、开箱体验

1. 接线

1)电源:15V

用type c输出的充电器给板子供电。
注意要用15V电源,一般输出是type c口的充电器都可以用于供电。
如果15V输入正常,D16 D15 D14会亮

如果输入的只是5v,只有D16会亮

以下是这3个指示灯的含义:
D16亮 5V存在
D15亮 9V存在
D14亮 15V存在

2)串口

用micro usb线连接电脑
注意:没有按开机键的时候,电脑端是检测不到串口的,这是正常的。

3)网线

如果测试网络功能

4)扩展板

官方有一个双摄像头的扩展板,可用于评估双目demo

5)TF卡

可以把启动模式改成从tf卡启动,一般如果跑Linux需要用到几百兆的根文件系统会选用tf卡。
平时调试用jtag,实际运行固化到qspi flash即可。

6)usb host

外接u盘或者其他usb外设

2.开关机

1)按SW7启动

插上电源并不会自动启动,电脑端也识别不到串口。
需要按右下角的SW7,才会开机。

2)关机:长按SW7十秒

长按SW7十秒
或者直接断电

3)复位:SW6

就在SW7的上方

3. 启动模式

在这里插入图片描述
在这里插入图片描述

三、FPGA开发

1. 测试时可以用来简单控制的外设

RGB LED 2个
拨动开关4个
红色LED 4个
压力传感器
温度传感器

在这里插入图片描述

2. 官方例子下载并编译

1)下载工程脚本

开发工具的版本选择:
因为ZU1这个器件比较新,老版本没有这个part,推荐用Vivado 2022.1及以上的版本

Vivado工程脚本从这里下载,如果你用的是其他版本,请查找对应的分支并下载
https://github.com/Avnet/hdl/tree/2022.1

另外还脚本会用到avnet的bdf,也需要下载
https://github.com/Avnet/bdf

下载完成后把这两个压缩包解压到同一个目录下

比如我解压到D:\debug\221下,解压后的目录结构如下,一定要注意不要多解压了一层目录,不然找不到bdf会出错。
在这里插入图片描述

2)用脚本生成Vivado工程

打开Vivado,找到下方的tcl console执行脚本
在这里插入图片描述

执行hdl/scripts/make_zub1cg_sbc_base.tcl脚本

具体路径根据你解压的路径修改,注意一定要进入到scripts目录再执行source。目录分割的斜杆是/,不是</font>

如果是因为路径问题执行报错,第二次执行的时候一定要完全关闭Vivado再重新打开,不然有可能环境变量已经被上次的错误操作修改了,导致反复执行都是报错。

如果是Synthesis阶段报错,这个是正常的,重新点一次Generate Bitstream继续执行

cd d:/debug/221/hdl-2022.1/scripts
source make_zub1cg_sbc_base.tcl

默认还提供了一个双摄像头的工程make_zub1cg_sbc_dualcam.tcl,需要另外外接双摄像头模块。操作方法跟上面是相同的,就不再重复了。

工程创建完成后,正常生成bit,导出xsa即可。

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