【ZYNQ-GPIO MIO】Xilinx 知识点笔记(GPIO篇、MIO)

1、GPIO是一个外设,用来对器件的引脚作观测(input)以及控制(output)。

2、MIO(Multiuse I/O),将来自PS外设和静态存储器接口的访问多路复用到PS的引脚上。

3、GPIO可以独立且动态地编程,作为输入/输出以及中断模式。

4、GPIO被分成了4个BANK,Bank0/Bank1通过MIO连接到PS的引脚,Bank2/Bank3通过EMIO连接到PL,可以通过配置其寄存器所在的地址对其进行控制。

5、软件通过一组存储映射的寄存器来控制GPIO。

6、寄存器组:

DATA_RO : 用来反映器件引脚的状态。

DATA : 在GPIO被配置成输出的时候,该寄存器可以控制输出的数值。

MASK_DATA_LSW : 用于屏蔽DATA 的低16位。

MASK_DATA_MSW : 用于屏蔽DATA 的高16位。

DIRM : Direction Mode 用于控制I/O引脚是作为输入还是输出。当为0时,关闭输出 驱动;当为1时,使能输出驱动。

OEN :Output Enable 仅当I/O被配置成输出时,该寄存器用于打开/关闭输出使能。当输出被禁用时,此时引脚处于三态,即此时引脚不受芯片控制,而是受外围电路所控制。0 :关闭输出使能;1 : 打开输出使能。

DIRM和OEN两个通过一个与门,只有当他们同时配置成高电平时,也就是DIRM为1,控制I/O为输出;OEN为1,使能输出驱动。两者同时为1,通过与门就可以使I/O配置成输出且打开输出驱动。

7、MIO[8:7]在系统复位过程中作为VMODE(配置bank的电压)引脚(作为输入),用于配置MIO bank的电压。复位结束后,MIO[8:7]只能作为输出信号。

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xlnx,zynq7k-Gpio是指Xilinx Zynq-7000系列的FPGA芯片中的通用输入/输出(GPIO)引脚。这些引脚可以配置为输入或输出,并用于与外部设备进行通信。根据引用,配置MIO47、MIO48和MIO49为GPIO时,需要向特定的寄存器写入特定的值。具体来说,使用XLNX_ZYNQ7K_SR_REGISTER_WRITE宏将0xF80007BC地址处的寄存器设置为0x00001600,以配置MIO47为GPIO;将0xF80007C0地址处的寄存器设置为0x00001600,以配置MIO48为GPIO;将0xF80007C4地址处的寄存器设置为0x00001600,以配置MIO49为GPIO。 根据引用,设置dir和oen变量的某些位,以配置MIO32到MIO53之间的引脚为GPIO。通过将0x34000的对应位设置为1,可以将这些引脚配置为输出。具体的寄存器地址和写入值可以根据系统的具体情况进行配置。 需要注意的是,以上引用提供的代码片段可能是在特定的开发环境下使用的,具体的配置和操作方式可能会因实际情况而异。<span class="em">1</span><span class="em">2</span><span class="em">3</span> #### 引用[.reference_title] - *1* *2* *3* [Xilinx zynq7000,zynq7k上GPIO使用笔记](https://blog.csdn.net/ambercctv/article/details/78328286)[target="_blank" data-report-click={"spm":"1018.2226.3001.9630","extra":{"utm_source":"vip_chatgpt_common_search_pc_result","utm_medium":"distribute.pc_search_result.none-task-cask-2~all~insert_cask~default-1-null.142^v93^chatsearchT3_2"}}] [.reference_item style="max-width: 100%"] [ .reference_list ]

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