Vivado ILA 使用问题记录

最新推荐文章于 2024-04-22 21:25:54 发布
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分类专栏： FPGA 文章标签： fpga开发
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1. 打开Hardware Manager，Run Trigger后无波形输出，Run Trigger Immediate后出现一个数据，但Core status处于Post-Trigger状态，没有采集到足够的数据。

对于这种情况，尝试降低JTag频率，但是没有效果。后来查阅文献，重新在Synthesis->Set Up Debug中修改了data depth（从2048降低到1024），再次调试打开Hardware Manager，可以触发出波形数据。

相关连接： Logic-Analyzer stucks in post-trigger state (xilinx.com)

nwpu061701
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Vivado与SDK的联合调试方法-使用ILA
DAYDAYUP
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下面是使用Vivado ILA的简要教程： 1. 将ILA模块添加到设计中：根据引用\[1\]中的说明，将ILA模块添加到需要进行调试的模块中。可以参考夏宇闻老师的《Verilog经典教程第三版》了解具体的Verilog语法。 2. 生成...

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