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2.2 图形化“行为级描述”(原理图):简化的2选1数据选择器
2.3 图形化“结构描述”(原理图):简化的2选1数据选择器
3.1 行为级描述:Verilog HDL的“module”语法:
3.2 结构级描述/门级描述:Verilog HDL的“module”语法
前言:
Verilog HDL是一门类C语言,语法结构与C接近,因此,从学习的角度来看,有C语言基础,学习Verilog HDL会非常方便,但Verilog是硬件描述语言,与C实质不同,在理解Verilog HDL语言执行逻辑的时候,切不可受到C语言程序在通用CPU上执行流程的思维惯性的影响。
这是学习Verilog HDL需要特别注意的地方!!!
这是很多人学习和理解Verilog HDL语言的最大障碍之一。
备注:本文并不在 Verilog HDL的详细语法细节,