verilog选择数据类型时常犯的错误

本文介绍了在Verilog编程中关于信号类型的常见错误,包括端口信号和内部信号的区分,输入输出端口的net和register类型规定。错误包括:非法赋值给net类型信号、实例输出连接到register类型信号、模块输入信号声明为register类型等,每个错误都给出了相应的错误信息。
摘要由CSDN通过智能技术生成

•    信号可以分为端口信号和内部信号。出现在端口列表中的信号是端口信号,其它的信号为内部信号。

•    对于端口信号,输入端口只能是net类型。输出端口可以是net类型,也可以是register类型。若输出端口在过程块中赋值则为register类型;若在过程块外赋值(包括实例化语句),则为net类型。

•    内部信号类型与输出端口相同,可以是net或register类型。判断方法也与输出端口相同。若在过程块中赋值,则为register类型;若在过程块外赋值,则为net类型。

•    若信号既需要在过程块中赋值,又需要在过程块外赋值。这种情况是有可能出现的,如决断信号。这时需要一个中间信号转换。

•    下面所列是常出的错误及相应的错误信息(error message)

用过程语句给一个net类型的或忘记声明类型的信号赋值。

           信息:illegal  …… assignment.

将实例的输出连接到声明为register类型的信号上。

           信息:<name> has illegal outputport specification.

将模块的输入信号声明为register类型。

           信息:incompatible declaration,<signal name>

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