【 FPGA/IC 】谈谈复位

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先谈谈亚稳态：

谈谈恢复时间：

谈谈异步复位：

谈谈同步复位：

谈谈异步复位，同步释放：

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本文本来是接着博文：【 FPGA 】关于FPGA中复位的设计问题（包含异步复位，同步释放方案）来写的，但是还是想说的更清楚些，更多的有自己的思考，或者自己的记忆。

先谈谈亚稳态：

我们都知道时序不满足会导致亚稳态问题，例如建立时间不满足，保持时间不满足都会导致亚稳态，也就是触发器的输出处于不稳定的状态，亚稳态时间段内，数值有可能是0，也有可能是1，总之是不确定的。

亚稳态是可以传播的，例如本该是逻辑0的，却成了1，之后亚稳态又传播了下去，导致逻辑错误，因此亚稳态是有害的。

时序问题会导致亚稳态，这句话很准确，但有哪些时序问题呢？仅限于建立时间和保持时间吗？当然不是，今天的复位问题就是其中之一。

谈谈恢复时间：

什么是恢复时间？异步复位就存在复位恢复时间不满足而导致亚稳态问题。

复位恢复时间是指释放一个复位有效信号时，也即复位撤离，复位信号的有效状态释放时刻和下一个时钟上升沿之间的时间。

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