Vivado中Debug的用法总结

最新推荐文章于 2025-03-03 13:17:46 发布
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分类专栏： # Vivado/ISE 区 Verilog/FPGA 实用总结区
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方式一：代码中例化ILA IP核

方式二：通过网表标记

方式三：代码中Mark_debug

Vivado中提供了多种Debug的操作方式，下面就来总结一下：

方式一：代码中例化ILA IP核

第一种，直接例化ILA IP核：

需要探测多少个信号，信号的位宽是多少，直接选择即可：

下面界面可以选择探测信号宽度以及触发方式：

可谓之简单粗暴，如果没人干预你，就这样用也没关系。

之后直接在程序中例化即可。

方式二：通过网表标记

综合后生成网表，在网表中设置Deb

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Vivado和ISE相比ChipScope已经大幅改变，很多人都不习惯。在ISE中称为ChipScope而Vivado中就称为in system debug。下面就介绍Vivado中如何使用debug工具。 Debug分为3个阶段： 1. 探测信号：在设计中标志想要查看的信号 2. 布局布线：给包含了debug IP的设计布局布线 3. 分析：上板看信号 一 探测信号 探测信号有2种方法一种是直接在HDL源代码中用（*mark_debug = “true”*）标...
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